Diferencias entre Procesadores CISC y RISC

Recopilacin hecha por la Ing. Patricia Ruiz

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Para agregar a la pgina 4, de la Lectura N 9
DIFERENCIAS ENTRE PROCESADORES CISC Y RISC:

CISC (Complex Instruction Set Computer, traducido: Computador con Conjunto de
Instrucciones Complejas): es un modelo de arquitectura de computadores.

CARACTERSTICAS:
1. Tienen un amplio repertorio de instrucciones.
2. Permite operaciones complejas entre operandos situados en la memoria o en
los registros internos (por ejemplo: los movimientos de cadenas de caracteres de
gran longitud y variable, en procesamiento de textos).
3. Las operaciones complejas requieren un nmero de pulsos que depende de la
secuencia de pasos necesarios para su ejecucin.
4. Debe contener una ROM de Control, que forma parte de la UC, para almacenar las
sucesivas combinaciones (microcdigos) que requiere la ejecucin de una
instruccin compleja.
5. Posee muchos Modos de Direccionamiento, para realizar la operacin que ordena
una instruccin.
6. Requiere un Compilador sencillo.
7. Hardware complejo.
8. Las instrucciones ocupan diferentes cantidades de bytes.
9. Menor velocidad que los RISC.
10. Menor nmero de registros de uso general de la CPU, que los RISC. Esto obliga a
utilizar ms instrucciones de LOAD-STORE, lo cual trae aparejado, en ms
accesos a MP respecto a los RISC.
11. Pierden mucho tiempo en las instrucciones de llamado a subrutinas y en las
interrupciones.
12. No incorporan un cach interno para instrucciones y otro para datos, salvo el
Pentium.
13. No puede aprovechar eficazmente su pipe line en la produccin de instrucciones,
debido a tener instrucciones ejecutables en diferentes pulsos de reloj.
Diferencias entre Procesadores CISC y RISC
Recopilacin hecha por la Ing. Patricia Ruiz
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RISC (Reduced Instruction Set Computer, traducido: Computador con Conjunto de
Instrucciones Reducidas) es un tipo de diseo de CPU generalmente utilizado
en microprocesadores o microcontroladores.

CARACTERSTICAS:
1. Tiene un reducido repertorio de instrucciones.
2. Permite instrucciones muy simples (como las que ordenan sumar o restar dos
nmeros que estn en registros de la CPU y el resultado asignarlo a uno de esos
registros).
3. Las instrucciones simples, luego de su decodificacin, pueden ejecutarse en un
pulso de reloj (muy pocas requieren de dos pulsos de reloj).
4. No requiere una ROM de Control (de microcdigos).
5. Presentan muy pocos Modos de Direccionamiento.
6. Es necesario un Compilador complejo.
7. Requiere un hardware simple.
8. Las instrucciones son de formato fijo.
9. Mayor velocidad que los CISC.
10. La superficie que ocupara la ROM de Control, la aprovecha para aumentar el
nmero de registros de uso general de la CPU. Esto, permite utilizar menos
instrucciones de LOAD-STORE, lo cual trae aparejado, en menos accesos a MP
respecto a los CISC.
11. Como poseen un nmero elevado de registros, stos pueden utilizarse para el
manejo de llamados, en lugar de perder tiempo para escribir y leer la pila ubicada
en memoria.
12. Incorporan un cach interno para instrucciones y otro para datos, por necesidad
de velocidad.
13. Puesto que la mayora de las instrucciones se ejecutan en un pulso de reloj,
resulta un pipe line eficaz, terminndose de ejecutar, en promedio, una instruccin
por pulso reloj.

NOTA: pipeline: Los circuitos del hardware le permiten ejecutar varias instrucciones
paralelamente (simultneamente), de una forma solapada: se comienza con la prxima
instruccin cuando an no se termin de procesar la primera. Es un mtodo por el cual se
aumenta el rendimiento del funcionamiento en computadoras y dispositivos similares,
aplicndolo al microprocesador.
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