ESCUELA DE CIENCIAS BSICAS, TECNOLOGA E INGENIERA

299008 MICROELECTRNICA
Actividad 07: Reconocimiento Unidad 2
2014-II


NIVELES DE ABSTRACCIN Y REPRESENTACIONES DE UN CIRCUITO
MICROELECTRNICO

La descripcin de un sistema en general, y de un circuito o sistema
microelectrnico en particular, se basa en tres procesos: la jerarquizacin, la
abstraccin y la representacin. El concepto de jerarquizacin, consiste en la
subdivisin del sistema en bloques de forma recursiva para conseguir que el nivel
de complejidad de cada parte sea abordable, ya que en la mayora de los casos
tratar todo el sistema de forma unitaria es imposible. No obstante, para determinar
algunos aspectos ser necesario manejar bloques de complejidad considerable y
es por ello que deberemos describir el sistema de forma que sea posible manejar
la informacin justa y necesaria y descartar los detalles que no necesitamos. En
otros casos ser necesario tener en cuenta todos los detalles y la informacin
disponible, pero entonces deberemos centrarnos por separado en partes
pequeas del sistema cuyo nivel de complejidad sea tratable. Este proceso es el
que denominamos abstraccin.

VARIABLES DE DISEO A NIVEL FSICO

Este es el nivel que se corresponde con la tecnologa mediante la que se
implementar el sistema. En el caso de circuitos integrados CMOS se trata de una
tecnologa basada en materiales semiconductores, aislantes y metales dispuestos
en capas en las que los elementos se interconectan tanto verticalmente
atravesando las capas aislantes como horizontalmente por medio de pistas
conductoras. Las variables que se manejan a este nivel estn relacionadas con las
propiedades de los materiales y con su forma. A este nivel el diseador
nicamente tiene control sobre el dibujo de las mscaras, por tanto la principal
variable de diseo a optimizar ser el rea ocupada por cada elemento del
sistema que repercutir en el rea global del CI.




DIAGRAMA DE FLUJO DE DISEO Y HERRAMIENTAS DE AYUDA AL
DISEO

El diseo de un sistema electrnico es un proceso que permite obtener a partir de
su especificacin una implementacin del mismo. La especificacin de un sistema
es una descripcin de su funcin y otras caractersticas requeridas para su uso,
como la velocidad, tecnologa y consumo de potencia; es decir, hace referencia a
qu hace el sistema sin especificar cmo. La implementacin de un sistema se
refiere a cmo ste est construido a partir de componentes ms simples. Para
cerrar el ciclo de todo el proceso, es necesario verificar mediante un proceso de
anlisis que la implementacin final del sistema se comporta como describa su




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especificacin, y en caso de no ser as, sta debe refinarse y volver a recorrer el
ciclo. Si el diseo es complejo, como ya se ha dicho anteriormente, es necesario
recurrir a una estrategia de diseo jerrquico o multinivel.

COSTES DE LA FASE DE DISEO

En el proceso de diseo normalmente intervienen diversas personas y,
especialmente si se trata del diseo de un sistema complejo, cada una de ellas se
dedica a una tarea especfica: simulacin de alto nivel, sntesis, diseo fsico,
simulacin elctrica, verificacin de integridad de seal (ruido), etc. A la hora de
asignar un coste al proceso de diseo se realiza un cmputo global del tiempo
dedicado al proyecto por parte de cada persona, y se suman las contribuciones de
cada una, obtenindose una medida de la dedicacin de personal a dicho proyecto
en unidades persona-tiempo. Lo que se obtiene es una medida del trabajo en
trminos de personal que ha representado el diseo. Por ejemplo, un proyecto de
18 personas-mes indica que 18 personas se han dedicado en exclusiva al
proyecto durante un mes cada una, o que 9 personas se han dedicado durante
dos meses, o el caso general, en que cada persona tiene una dedicacin diferente
y globalmente el proyecto tiene una asignacin de 18 personas-mes.

MODELOS Y SIMULADORES ELCTRICOS

A este nivel el transistor y el resto de componentes se representan mediante
componentes circuitales regidos por un modelo matemtico que puede tener
diversos grados de complejidad, en funcin de la exactitud que se precise. Este
modelo se extrae del comportamiento real de los componentes aislados utilizando,
o bien una formulacin analtica, o bien un ajuste a las curvas empricas. Las
variables con las que trabajan estos modelos son la tensin y la corriente en los
nodos y ramas del componente. Los modelos se expresan como una serie de
expresiones donde intervienen estas variables elctricas y unos parmetros que
deben proporcionarse para cada tipo de componente.

La mayora de estos parmetros, denominados parmetros de fabricacin o
tecnolgicos dependen de la estructura fsica del dispositivo y sus materiales y
vienen dados por el fabricante del circuito integrado en base a medidas
experimentales que ste ha realizado sobre circuitos de prueba.

VHDL BSICO

Una alternativa para modelar diseos en un FPGA es utilizar HDLs, los ms
conocidos son VHDL y Verilog ya que se trata de lenguajes estandarizados; sin
embargo no son la nica opcin, existen otras alternativas como Handel-C y Abel,
entre otros. VHDL fue desarrollado como un lenguaje para el modelado de



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sistemas digitales. Proporciona una sintaxis amplia y flexible que permite el
modelado estructural, en flujo de datos y de comportamiento de hardware. VHDL
est regido bajo el estndar IEEE 1076-1993, lo que favoreci su adopcin en la
industria y se ve reflejado en las constantes mejoras de sus herramientas; debido
a su estandarizacin, un cdigo en VHDL puede ser portable a diferentes
herramientas y tambin puede ser reutilizado en diferentes diseos.

VHDL es un lenguaje de descripcin de hardware que se utiliza para modelar,
documentar, simular, verificar y sistematizar un sistema digital. Por tanto abarca el
ciclo completo de diseo, salvo el trazo fsico o layout, desde las especificaciones
iniciales hasta la construccin del prototipo hardware.

NIVELES DE DESCRIPCIN VHDL

VHDL es un lenguaje descriptor de hardware de gran generalidad derivada del
lenguaje de alto nivel ADA43. Dispone de tipos abstractos para definir el formato y
valores de seales, variables, constantes, etc. y proporciona amplias facilidades
para la realizacin de algoritmos. Los diferentes niveles de descripcin que
maneja VHDL son los siguientes:

Nivel algortmico: Es el nivel con mayor grado de abstraccin. Aqu el
diseador solo describe el comportamiento del sistema, sin preocuparse de las
seales o componentes internos del mismo. Por ello al referirse a l se suele
hablar de nivel de comportamiento o descripcin de alto nivel.

Nivel de transferencia de registros: (RTL, Register Transfer Level). Este
nivel proporciona un cierto grado de abstraccin con respecto al hardware, pero el
diseador se ve obligado a describir las distintas seales que interactan en un
circuito y su comportamiento en funcin de las entradas por medio de ecuaciones
lgicas y sentencias de asignacin.

Nivel lgico: Utiliza los recursos que el lenguaje proporciona para describir las
interconexiones entre los distintos componentes de un circuito. Otra denominacin
habitual para referirse a este nivel es la de estructural.

MODELOS Y SIMULADORES DE ALTO NIVEL

Histricamente, la descripcin ms utilizada ha sido la RTL (del ingls Register
Transfer Level). Dicho cdigo RTL describe cada bit de estado en el sistema y
todas las operaciones que pueden tener lugar en ese estado. Describe tambin
cada registro, matriz de memoria, bloque aritmtico y lgico. Esta descripcin es
de forma estructural, pero no tiene por qu corresponderse con la implementacin




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exacta que despus tendr cada bloque, ya que lo importante es describir la
funcionalidad del sistema y sus partes y poder evaluarla conjuntamente. Dado que
la representacin es de tipo estructural, es posible utilizar tambin un esquemtico
para describir el sistema de forma RTL.

Posteriormente los avances en informtica y herramientas CAD han permitido
elevar an ms el nivel de abstraccin y utilizar construcciones muy parecidas a
las de los programas y algoritmos software (bucles, clusulas if-then-else, etc.). El
sistema queda descrito entonces de forma funcional. Existe la posibilidad de
traducir una especificacin HDL de este tipo funcional a una descripcin RTL, y
sta es una de las tareas de los programas de sntesis.

VALIDACIN Y PRUEBA DE CIRCUITOS INTEGRADOS

Si bien durante la fase de diseo se tiene un acceso ilimitado a todos los nodos de
un circuito, lo que permite observar respuestas de forma no restringida, este no es
el caso de un componente fabricado; entonces el nico acceso al circuito ha de
realizarse a travs de un nmero limitado de patillas de entrada/salida, por mucho
que el componente sea extremadamente complejo en trminos del nmero de
posibles estados. A esto hay que aadir el hecho de que el equipamiento de
pruebas de circuitos integrados suele ser extremadamente caro, por lo que cada
segundo que se invierta en el test de un componente supondr un incremento de
su precio. Hay que tener en cuenta que los equipos de test actuales rondan los 10
millones de dlares, y en unos aos su coste alcanzar los 50-100 millones de
dlares para poder hacer frente a la complejidad y velocidad de los circuitos
integrados que se avecinan.

Es conveniente, por tanto, considerar los aspectos de test desde las primeras
etapas del proceso de diseo; modificaciones mnimas en estas etapas pueden
ayudar a facilitar en gran medida la validacin del componente. Esta aproximacin
al diseo, introduciendo las necesidades del test como parte de las
especificaciones, se conoce como "diseo para la prueba" (DFT Design For
Testability). Cualquier estrategia DFT contiene una doble exigencia:

Proporcionar la circuitera necesaria para que el procedimiento de prueba sea
rpido y extensivo.

Proporcionar los patrones de test (vectores de excitacin) necesarios, de forma
que la secuencia de test sea lo ms corta posible, cubriendo a la vez la mayora
de los posibles fallos.







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DISEO BOUNDARY-SCAN

Hasta hace poco, el problema del test slo lo era realmente al nivel de los CIs; el
test de las tarjetas de circuito impreso quedaba facilitado por la abundante
disponibilidad de puntos de test. El cuadro ha cambiado con la introduccin de las
tcnicas avanzadas de encapsulado (montaje superficial o mdulos multichip), y
esto ha reducido significativamente la controlabilidad y observabilidad a este nivel,
ya que el nmero de puntos donde pueden hacerse medidas se ha visto muy
disminuido. Este problema puede abordarse extendiendo el concepto de test scan-
based al nivel de tarjetas y componentes.

La aproximacin resultante se denomina boundary-scan (cuya traduccin podra
ser "chequeo en las fronteras de los componentes") y se ha estandarizado para
asegurar la compatibilidad entre los diferentes proveedores (JTAG - Joint Test
Action Group), dando lugar a la norma IEEE 1149. En esencia, conecta los pines
de I/O de los componentes de una tarjeta en una cadena serie de test.

















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gitales&ots=Xu5Tc75n2H&sig=V2xrnJQn323F9d7awR6hiF_fWcM
Gilmore, C. M. (1995). Microprocessors: Principles and applications. McGraw-Hill.
La edicin del material didctico del curso 299008, diseado por Faiber Robayo, del programa
Ingeniera Electrnica estuvo a cargo de la ECBTI de la Universidad Nacional Abierta y a Distancia
(UNAD).
Derechos reservados:
2012, Universidad Nacional Abierta y a Distancia - UNAD
Vicerrectora de Medios y Mediaciones Pedaggicas, Bogot D.C.
Calle 14 Sur No. 14 23