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PROGRAMACION APLICADA

DOCENTE:FRANCO RIVERO NOLASCO

MANEJO DEL Veribest Bsico

En este ejemplo se va a compilar un programa muy bsico (un inversor de


una sola entrada) lo primero que haremos es ejecutar nuestro compilador y
simulador ya conocido VERIBEST.
Seguramente les aparecer una ventana con el siguiente mensaje

No te preocupes solo es un mensaje que indica que no podr actualizar el


sistema, entonces dale click en aceptar e inmediatamente se ejecutar el
programa Veribest.

El siguiente paso es crear un espacio de trabajo (crearemos nuestro


proyecto), para lo cual nos vamos a la barra de men y hacemos click en
Workspace.

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En ese momento nos saldr la siguiente ventana.

Ahora le damos el nombre de inversor en la ventana (workspace Name) y le


damos la ubicacin en la unidad que grabaras tu proyecto y luego haces click
en el botn create.
Ahora te aparecer una ventana de trabajo con el nombre de actividad1
donde podrs indexar las ediciones de la Entidad y la Arquitectura de tu
programa. Para esto lo nico que haces es ir a la opcin File -> new y te
aparece una ventana new y seleccionas (VHDL source file) para generar tu
archivo VHDL y le dices ok.

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Ahora pones todo el cdigo perteneciente a la entidad y a la Arquitectura


como en la imagen anterior. Ahora guarda tu programa para esto debes ir a
la opcin FILE -> sabe As, luego darle el nombre que quieres en este ejemplo
le daremos invesor.vhd (ojo escribe luego del nombre la extensin vhd).
Le das la ubicacin donde quieres que grabe tu archivo y le dices guardar (ojo
la ubicacin donde guardes esta edicin de cdigo debe estar en el mismo
lugar donde guardaste tu proyecto inversor.
Haces lo mismo para el TEST_BENCH (click en file, new, VHDL source file)
donde inyectaremos las seales para simular nuestro cdigo.

En este caso guardamos esta ventana con el nombre de test_inversor.vhd en


la misma ubicacin del proyecto (inversor y el archivo inversor.vhd).
Ahora en nuestra hoja de trabajo aadiremos los dos archivos guardados
(inversor.vhd y test_inversor.vhd) de la siguiente forma. Haz click en el cono
(+) de la ventana de trabajo inversor del proyecto creado como se muestra
en la figura siguiente.
Escoges los archivos y le dices abrir

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Ventana de trabajo

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ventana de trabajo

El siguiente paso es compilar los dos archivos (inversor.vhd y


test_inversor.vhd) y lo realizamos haciendo click en el icono (compile all o
presionando Alt+F8), si todo sale bien les debera salir la siguiente
informacin en la ventana de informacin de compilacin como se observa
en la siguiente figura.

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Ahora pasemos a la simulacin y por ende a la visualizacin de las graficas de


respuesta del dispositivo.
Para esto antes configuramos nuestro simulador con los siguientes paso:
Hacer click en workspace, luego click en settings, les saldr la ventana
siguiente.

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Ahora en la misma ventana habilita la opcin dibug solamente y los dems


quedan desactivos como se muestra en la figura anterior.
El paso siguiente en la misma ventana pero en la pestaa Simulate poner
todos los datos tal como la siguiente figura:

Por ltimo haz click en Aceptar.


Ahora empecemos la simulacin para esto hacer click en Execute Simulator o
Ctrl+F5.

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Les saldr la siguiente ventana:

Hacer click en Aceptar


Para ejecutar la simulacin click en Run o presionar F5

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Para visualizar las grficas de respuesta de la simulacin hacer click en el


cono WaveForm Window.

Les saldr la siguiente ventana:

Ahora aadir todas las seales haciendo click en Add Signals y enseguida les
sale la siguiente ventana.

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Ahora click en Add all y eneguda les sale la grafica de comportamiento del
dispositivo en nuestro caso un inversor.

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