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Circuitos Digitales II
FECHA DE REALIZACIN:
FECHA DE ENTREGA:
TABLA DE CONTENIDO:
Pgina
191064
19/10/15
25/09/15
Anlisis de circuito:
Para el anlisis del circuito mostrado es necesario conocer en primer lugar
la funcin que cumple cada pin de los circuitos integrados; para esto, ser
necesario revisar el Data Sheet de cada C.I. , luego de conocer la funcin de
cada pin ser necesario separar por bloques el circuito para de esta manera
facilitar el anlisis.
III
IV
SW1
de
I/O
la
I/O
5
PTO. 1
74LS244
ACTIVADO
74LS244
DESACTIVA
DO
ESCRITURA Y LECTURA:
Para el caso donde se almacenara la palabra HOLA y luego se la visualiza:
Primero se debe entender el siguiente diagrama:
Direccin
A1
A0
0
0
0
1
1
0
1
1
D7
x
x
x
x
D6
1
0
0
1
D5
1
1
1
1
Palabra
D4
D3
1
0
1
1
1
1
1
0
letra
D2
1
1
0
1
D1
1
1
0
1
D0
0
1
0
1
H
O
L
A
*se pone una x en D7 ya que este bit no se utiliza para formar letras en el
display.
Habilitar memoria: dicha seal tiene que mantenerse en bajo durante
todo el proceso, caso contrario la memoria no estar en funcionamiento.
D5
1
D4
1
D3
0
D2
1
D1
1
D0
0
D5
1
D4
1
D3
1
D2
1
D1
1
D0
1
10
D5
1
D4
1
D3
1
D2
0
D1
0
D0
0
11
D5
1
D4
1
D3
0
D2
1
D1
1
D0
1
12
*no es aconsejable dejar las entradas CLEAR Y SET al aire, por lo que se debe
conectar a fuente. La frecuencia del generador es 1Hz.
13
CONCLUSINES:
APNDICE
DATASHEET DE LA MEMORIA SRAM 6116
DIAGRAMA DE BLOQUES:
15
TABLA DE
VERDAD:
CARACTERISTICAS GENERALES:
RANGOS MAXIMOS:
16
17
18
19
Integrados en chip:
En circuitos integrados.
En FPGAs y CPLDs.
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Uso de aficionados
Los aficionados a la electrnica prefieren las memorias SRAM debido a su
sencilla interfaz, ya que es mucho ms fcil trabajar con SRAM que con DRAM,
al no existir ciclos de refresco, y poder acceder directamente a los buses de
direccin y de datos en lugar de tener que utilizar multiplexores. Adems, las
SRAM solo necesitan tres buses de control: Chip Enable (CE), Write Enable (WE),
y Output Enable (OE). En el caso de las SRAM sncronas, se tiene adems la
seal de reloj (CLK)
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