Professional Documents
Culture Documents
ANALOGA
ResumenSe realizo el analisis de tres distintos circuitos amplificadores diferenciales. Este analisis consistio en
una evaluacion desde la teora, la simulacion y la practica.
En cada caso se determino los valores de polarizacion de
los circuitos, las ganancias diferenciales, comunes y el
factor de rechazo (CMRR). En particular, se comprobo
que la atenuacion es mejor en los dos amplificadores que
en lugar de contar con una resistencia tenan una etapa
de polarizacion. As mismo, que una carga activa en lugar
de resistencias en el colector del par diferencial da lugar
a una ganancia diferencial mayor.
Palabras ClaveAmplificador diferencial, transistor
BJT, etapa de polarizacion, modo diferencial, modo
I. I NTRODUCCI ON
N esta practica se diseno y se realizo el montaje
de un circuito de amplificacion diferencial con
transistores BJT 2N3904. El diseno se llevo a cabo
siguiendo como lineamiento determinados valores de
polarizacion y amplificacion dados por la gua [1].
As mismo, se realizo el montaje de un amplificador
diferencial con carga activa por medio de un circuito
integrado CA3086 y transistores BJT 2N3906. En
ambos casos se comparo lo obtenido en la practica con
una simulacion realizada en Altium Designer (16.0).
6)
II. M ARCO TE ORICO
(S ESI ON
II-A. Diseno de amplificador con carga
En primer lugar se diseno un amplificador diferencial con una carga resistiva en los emisores (figura
1). Este amplificador deba satisfacer las siguientes
especificaciones (tabla I):
II-B.
cion
RC1
2VT |Avd |
RC1 =
= 505
2re
IC1
VDD
(V)
-6
IC1
(mA)
10
IC2
(mA)
10
|Avd |
(V/V)
100
VBEon VDD
0.65 + 6
=
= 267.5
IC1 + IC2
20
e-mail: df.gomez11@uniandes.edu.co
VBEon VDD
= 132.4
2IC3
= VDD + RE IE3 = 3.33V
RE =
VE3
LABORATORIO DE ELECTRONICA
ANALOGA
VB3 = VDD
II-C.
1
R1
VDD
R1 =
R2
R1 + R2
VB3
1
6
=
5 = 4K
2.68
LABORATORIO DE ELECTRONICA
ANALOGA
RC1
= 2.42 102 V/V
re + 2RO
Avd
CMRR = 20 log10
= 72.32dB
Avc
Avc =
IV.
Avc =
1
2
r04
2r05
2
r3
gm +
2
r3
gm +
!
2
r3
1
r03
2
r3
Avd
Avc
R ESULTADOS DE SIMULACI ON
!
1
r03
CMRR = 20 log10
= 102.50dB
III. P ROCEDIMIENTO
Cada uno de los circuitos se implemento en una protoboard (figuras 4, 5 y 6). Algunas de las resistencias se
reemplazaron por potenciometros, dado que por falta
de una completa simetra las corrientes deseadas no
eran las mismas que las esperadas, si bien era poco lo
que variaban.
La toma de medidas consistio en los tres casos en
tres partes. Primero se abra el circuito en alguno
de los puntos sobre los que se quisiera que pasara
determinada corriente y se meda con un multmetro la
corriente. Si el valor se alejaba de la teora se variaba
alguno de los potenciometros. En segundo lugar, se
desconectaba una de las bases del par diferencial de
tierra y se conectaba a una fuente generadora, que
se configuraba con una senal de salida sinusoidal
con amplitud de 20 mVpp y frecuencia de 1KHz.
Posteriormente se repeta lo mismo con la otra base y
despues se haca con ambas, para observar la respuesta
en modo comun.
IV-A.
Comportamiento DC
LABORATORIO DE ELECTRONICA
ANALOGA
Figura 7: Simulacion de modo diferencial del amplificador diferencial con carga en el emisor
Figura 9: Simulacion de modo diferencial del amplificador diferencial con carga activa
Figura 8: Simulacion de modo diferencial del amplificador diferencial con etapa de polarizacion
IV-B.
Figura 10: Simulacion de modo diferencial del amplificador diferencial con carga activa y resistencia de 10
K
Comportamiento AC
Avd
626.36
Avc
0.933
Carga
Activa
Avc
1103
CMRR
37.59
CMRR
115.94
Avd
69.66
Etapa de
Polarizacion
Avc
CMRR
8.3103
78.47
V.
V-A.
R ESULTADOS PR ACTICOS
Comportamiento DC
LABORATORIO DE ELECTRONICA
ANALOGA
Figura 11: Simulacion de modo comun del amplificador diferencial con carga en el emisor
Figura 13: Simulacion de modo comun del amplificador diferencial con carga activa
Figura 14: Simulacion de modo diferencial del amplificador diferencial con carga en el emisor
Figura 12: Simulacion de modo comun del amplificador diferencial con etapa de polarizacion
V-B.
Comportamiento AC
Figura 15: Simulacion de modo diferencial del amplificador diferencial con etapa de polarizacion
LABORATORIO DE ELECTRONICA
ANALOGA
Figura 16: Simulacion de modo diferencial del amplificador diferencial con carga activa
Figura 17: Simulacion de modo diferencial del amplificador diferencial con carga activa y resistencia de 10
K
Figura 19: Simulacion de modo comun del amplificador diferencial con etapa de polarizacion
Figura 20: Simulacion de modo comun del amplificador diferencial con carga activa
Tabla IV: Error relativo (en porcentaje) de ganancias
en el laboratorio con respecto a las teoricas y de
simulacion
Avd
174.47
Avc
1.13
Carga
Activa
Avc
-
CMRR
34.92
Avd
67.59
Etapa de
Polarizacion
Avc
2.96102
CMRR
67.17
CMRR
-
e(Avd )
Teora
Sim.
37,07
10,95
e(Avd )
Teora
Sim.
32,41
2,97
Avd
Teora
Sim.
86,91
72,15
Carga
e(Avc )
Teora
Sim.
20,21
21,11
Etapa dePolarizacion
e(Avc )
Teora
Sim.
22,31
256,63
CargaActiva
e(Avc )
Teora
Sim.
-
VI.
e(CMRR)
Teora
Sim.
13,87
7,11
e(CMRR)
Teora
Sim.
7,12
14,40
e(CMRR)
Teora
Sim.
-
A N ALISIS
Figura 18: Simulacion de modo comun del amplificador diferencial con carga en el emisor
LABORATORIO DE ELECTRONICA
ANALOGA
En este caso no se puede realizar un analisis cuantitativo en el sentido estricto de la palabra, dado el
comportamiento de saturacion que presento la senal de
salida tanto en la simulacion como en el laboratorio.
Esta saturacion se presenta dado que la ganancia del
circuito es demasiado grande (mas de 1000) y las
fuentes de voltaje de polarizacion no son aptas para
este amplificador. O por otro lado, el diseno no es
correcto y el amplificador sale de la region de operacion activa y pasa a la de saturacion, lo que es
indeseable en un amplificador funcional. Sin embargo,
tambien resulta claro que con una corriente similar
(e incluso la mitad) que la de los dos amplificadores
anteriores, la ganancia diferencial desbalanceada es
bastante mayor, lo que se debe a la presencia de
la carga activa conformada por los transistores pnp.
Esta permite que la amplificacion desbalanceada sea la
misma que lo que sera la balanceada con cargas en los
colectores comunes y corrientes. Adicionalmente, el
espejo de corriente de este amplificador cuenta con una
resistencia de salida mayor que la etapa de polarizacion
del segundo amplificador (presumiblemente, dado que
no se conoce con certeza los valores de los voltajes de
Early para ninguno de los transistores o el integrado).
Por u ltimo, cabe mencionar que el gran error entre la
simulacion y la teora se debio posiblemente a que la
entrada en la practica fue de casi 40 mVpp y no 20
mVpp como en la simulacion, lo que significa que las
consideraciones ideales de linealidad posiblemente no
se cumplan del todo para el amplificador montado en
el laboratorio.
VII.
C ONCLUSIONES