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CMOS
(a) NAND
(b) NOR
(c) AND
(d) OR
3.
M2
M1
A
B
4.
5.
+VDD
(a) NAND
M3
(b) NOR
(c) AND
(d) OR
Y
A
M1
M2
ACE
6.
(EC-GATE 2012)
5Volts
(a) Y A B C
(b) Y (A B)C
55
C
Y
(c) Y A BC
(d) Y AB C
7.
(c) AB + C
Y
C
(d) AB C
A
8.
(b) AB C
. D E
output
D
C
+5V
9.
Logic Input
A to E
PMOS
Network
Y
(b) (A B) (C D) E
(c) AB + CD + E
(d) (A + B) (C + D) E
E
ACE Engineering Academy (Hyderabad, New Delhi, Vijayawada) ( Copyrights reserved)
56
10.
CNOS
ACE
(a) (A + B)C + D
(b) AB C D
(c) A BC D
D
Y
A
(d) AB CD
11.
O/P
B
A
12.
Q
X1
X2
(a) X 1 X 2
(c) X 1 X2
(b) X1 X 2
(d) X1 X2
ACE
13.
57
(a) AB C
A
(b) A + BC
(JTO -2001)
T1
T2
T3
f
T4
A
(c) A(B + C)
C
T6
T5
(d) ABC
14.
15.
(a) P NOR Q
(b) P NAND Q
(c) P OR Q
(d) P AND Q
For the NMOS logic gate sown in figure, the logic function
implemented is
(EC-GATE 1997)
VDD
(a) ABCDE
(b) AB C . D E
(d) A B .C D. E
F
A
B
D
C
58
16.
CNOS
ACE
(a)
A B. D.E C
(d)
A.B D. E .C
(c)
A.B D E.C
(d) False
17.
+VDD
Y
A
A
B
(a)
ABC ABC
(c)
ABC A B C
(b) ABC A B C
(d) None of the above
ACE
18.
19.
20.
59
(EC-GATE 2003)
60
21.
CNOS
ACE
Vin
ACE
23.
PMOS
(c) 45 A
(d) 90 A 2.5V
24.
61
NMOS
25.
M1
| VTp | 1 V
VTn 1 V
M2
62
CNOS
ACE
26.
27.
28.
V0
Vi
-5V
(a) 5V and 0V
(c) 0V and 3V
29.
(b) 5V and 5V
(d) 3V and 5V
ACE
30.
31.
63
(a) 5V and 0V
(b) 5V and 5V
(c) 0V and 5V
V0
Vi
(d) 3V and 3V
5V
32.
33.
(EC-IES 2001)
64
CNOS
ACE
34.
35.
(a) 5 ns
(b) 10 ns
(c) 20 ns
(d) 50 ns
36.
37.
(b) 1V
(c) 1.5V
38.
(d) 0.5V
a)
4V, 3V, 2V
b) 5V, 5V, 5V
c)
4V, 4V, 4V
d) 5V, 4V, 3V
ACE
65
a)
b)
c)
d)
A B C
A B C A.C
A BC
A.B .C