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2: Ttulo de la Actividad:
Diseo, Implementacin, Simulacin y Validacin de un Circuito en Lgica
Combinacional
3: Datos personales:
- Nombre y Apellidos: Alejandro Domnguez Al-lal
- DNI: 45312176Z
- Centro asociado: Centro Asociado de Melilla
5: Enunciado.
Enunciado
Disee el circuito del codificador y selo para controlar las operaciones de la ALU que se
han especificado.
SOLUCIN:
6: Diseo de los distintos bloques funcionales (para cada uno de los bloques debe
presentar: la tabla de verdad terica, las expresiones lgicas de las variables de
salidas y explicar el diseo realizado).
7: Implementacin de cada uno de los bloques funcionales en el simulador PSpice
(para cada uno de los bloques debe presentar: el esquema, el cronograma resultante
y la verificacin de que su funcionamiento es el deseado).
Codificador
Circuito Adjunto: Codificador.sch
Segn los valores de entrada podemos tener cuatro estados de salida que corresponden a
cada una de las operaciones que realizar la ALU. Para representar estos cuatro estados
nos basta tener dos bits
o lineas de salida del circuito, S1 y S2, las cuales corresponden a las salidas de U1A y
U2A respectivamente.
C1=P2+P1 C0=P2+(invP1*P0)
En este caso, las casillas con X indican que no nos importa si valor, pues la prioridad la
marca el mayor 1 del orden de prioridad (P2>P1>P0)
Como podemos comprobar, los valores se cumplen para todos los casos representados
en la tabla de verdad.
Valores para los relojes y la simulacion
P2: ONTIME=1ms / OFFTIME=1ms
P1: ONTIME=2ms / OFFTIME=2ms
P0: ONTIME=4ms / OFFTIME=4ms
Para esta demostracion solo tomaremos los primeros 8 intervalos, por ofrecer estos una muestra
suficiente.
Intervalo P2 P1 P0 C1 C0 Operacin
0-1ms 0 0 0 0 0 1
1-2ms 1 0 0 1 1 A Plus AB
2-3ms 0 1 0 1 0 A*B
3-4ms 1 1 0 1 1 A Plus AB
4-5ms 0 0 1 0 1 A Plus B Plus 1
5-6ms 1 0 1 1 1 A Plus AB
6-7ms 0 1 1 1 0 A*B
7-8ms 1 1 1 1 1 A Plus AB
OP ALU S3 S2 S1 S0 M Cn
1 1 1 0 0 1 X
A plus B plus 1 1 0 0 1 0 0
A*B 0 0 1 0 1 X
A plus AB 1 0 0 0 0 1
La seleccin de operacin de la ALU depende del circuito codificador con prioridad diseado
previamente, el cual, dependiendo de tres entradas (P), obtiene dos salidas (C) que codifican las
operaciones que realizar la ALU.
Segn el valor de C1 y C0 las entradas de la ALU S3, S2, S1, S0, M y CN tienen que tomar los
valores indicados anteriormente. Esta relacin se puede expresar matemticamente de la
siguiente
forma:
S3 = (C1*C0)+(C1*C0)+C1C0
S2 = C1*C0
S1 = C1*C0
S0 = C1*C0
M = C1*C0+C1*C0
CN = C1*C0
Para sintetizar las anteriores ecuaciones he aadido entre el circuito codificador y la ALU dos
puertas inversoras, una para C1 y otra para C0, y otras tres puertas OR y ocho AND para poder
representar las relaciones matemticas arriba expuestas y se seleccionen las operaciones
correctas de la ALU en funcin de los valores de C1 y C0
Viendo la tabla, podemos comprobar como todas las operaciones se realizan de manera correcta,
seleccionado correctamente la prioridad en cada operacin.
Comentarios
Para esta practica, la mayor dificultad que he encontrado ha sido la representacin de la seal
S3, puesto que a la hora de sacar la funcin lgica por mapas de Karnaugh, mostraba la
posibilidad de usar una puerta XOR negada, lo cual provocaba que esta salida no mostrara los
resultados correctos