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procesadores segmentados (o en pipeline), los cuales incorporan una tcnica para acelerar el
ritmo de ejecucin de las instrucciones.
En primer lugar empezaremos por comentar algunos aspectos bsicos para introducir los
conceptos en los que se apoya esta tcnica.
A continuacin nos centraremos en nuestro procesador de referencia, el MIPS64, viendo la
configuracin de las etapas que componen su cauce.
Como veremos, hay diversos factores que pueden impedir un aprovechamiento ptimo del
concepto de pipeline en la CPU. Trataremos estos factores y las tcnicas para evitarlos en la
medida de lo posible.
Por ltimo abordaremos una mejora ms del pipeline mediante el concepto de operaciones
multiciclo que reducirn las esperas o paradas generadas por las instrucciones pesadas, como
las multiplicaciones, divisiones o las operaciones en coma flotante.
En los cauces con operaciones multiciclo, adems de que las dependencias RAW se pueden
producir ms fcilmente, tambin aparecen los otros dos tipos de dependencias.
No olvidemos tampoco, que este tipo de problemas solo se pueden producir con programas en los
que hay secuencias de instrucciones sin sentido, es decir, instrucciones que producen resultados
que no son utilizados por ninguna instruccin posterior.