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Laboratorio
1. LISTA DE MATERIALES
Circuitos integrados TTL como ser: 7400, 7402, 7404, 7408, 7410, 7411, 7432,
etc.
Circuitos integrados TTL Flip – Flops como ser: 7474, 7476, 74112, 74174, etc.
Dip Switch de 12 canales mínimo.
Switch de tres posiciones.
Lote de resistencias de 1K – 5K [Ω], de protección de 100[K] (dos unidades) y
de 330[]. (varias unidades).
Condensadores Electrolíticos de 1, 10 y 100 [µF].
Led`s de diversos colores.
Diversos tamaños de cables de conexión.
Proto board de 2 cuerpos mínimo.
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Consideraciones previas al laboratorio.
Todo circuito secuencial síncrono obedece a una señal patrón denominado “Clock” que
traducido al español es reloj, esta señal se la puede conseguir de diversas formas. A
continuación, mostraremos tres tipos que se usarán en laboratorio:
S
1k-5k Q
SW
1k-5k Q
R
Vcc
L1
U1A U1B
R1
R2 C1
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c) Oscilador Astable Con Circuito Integrado LM555
Puede ser implementado con el CI LM555 en modo oscilador astable de onda cuadrada
(t1=t2), con una frecuencia variable (5Hz a 500Hz) tal que el usuario pueda manipular, ver
y controlar los estados del circuito secuencial.
+5V
RA
5.000 V
R1
A: u1_3
1k
2k 555 4.000 V
1 Gnd Vcc 8
A 2 Trg Dis 7
A 3 Out Thr 6 3.000 V
4 Rst Ctl 5 RB
1k 2.000 V
.IC
RL
10k
1.000 V
+
C1 CT
.01uF .1uF 0.000 V
0.000ms 0.200ms 0.400ms 0.600ms 0.800ms 1.000ms
OBJETIVO GENERAL
Analizar el funcionamiento de circuitos secuenciales básicos e implementarlos en
laboratorio.
OBJETIVOS ESPECIFICOS
Tenemos los siguientes por cada experimento:
a) Aprender y analizar el funcionamiento de los circuitos eliminadores de
rebotes y osciladores para la aplicación a los sistemas secuenciales,
definiendo claramente la aplicación de cada una.
b) Presentar el funcionamiento de los circuitos secuenciales llamados básculas,
cerrojos, biestables, ó “flip flops” capaces de registrar o memorizar un
evento de entrada. Son los elementos de memoria básicos por que pueden
almacenar un 1 o un 0 de forma permanente.
c) Presentar nuevos tipos de flip flops que precisan de una señal de
sincronismo adicional para la activación/ desactivación de su salida Q.
d) Presentar las características de este tipo de flip flop asíncrono, que la hace
distinguirse de los demás por su completa tabla de verdad solucionando
problemas presentados en los anteriores flip flops.
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e) Continuar con el estudio del anterior flip flop, con la diferencia de que en
este caso se cuenta con la señal de sincronismo denominado reloj “Ck”.
f) Estudiar el funcionamiento del flip flop más sencillo de manejar, pero
dificultoso en su armado, ver la importancia de su funcionamiento, para su
posterior aplicación en muchos diseños de circuitos digitales.
g) Aplicar métodos de síntesis por CAD (VHDL: ISE Fundation y Quartus II)
h) Aplicar los conocimientos adquiridos por el estudiante durante la
experimentación del presente laboratorio y plasmarlos en la proposición de
un ejemplo y desarrollarlo en laboratorio.
Se debe realizar el programa en VHDL para los puntos de la guía que contengan
circuitos sintetizables utilizando uno de los tres métodos de:
Funcional Algorítmico o de Comportamiento.
Flujo de Datos ó RTL.
Estructural o Lógico.
y simularlo en ISE de XILINX y Quartus II de ALTERA.
Diseñar el circuito de un FF-SR asíncrono con NAND y otro con NOR establecer la
TV y el diagrama de tiempos de cada uno y compararlos con la TV del CI74279.
Realizar los FF-JK asíncronos en base a FF-SR (con AND y NOR) con preset y reset,
establecer la TV y el diagrama de tiempos, compararlo con la TV del CI74107.
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e) FLIP FLOP JK SINCRONO
e.1) Transforme los FF’s del anterior punto en FF síncronos de nivel. Indique las
desventajas de ser FF síncronos de nivel.
e.2) Realizar un FF-JK síncrono de flanco descendente con operadores NOR, con
preset y reset, establecer la TV y el diagrama de tiempos.
e.3) Realizar un FF-JK síncrono de flanco ascendente con operadores NAND, con
preset y reset, establecer la TV y el diagrama de tiempos.
SIMULACIÓN
5. REALIZACIÓN DE LABORATORIO.
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b) BIESTABLES S-R ASINCRONOS
Una vez montado el circuito anotar su tabla de verdad en su hoja de datos. Comprobar
que cuando las entradas S y R están ambas a 0 la salida Q conserva el último estado
anterior. Por otra parte, cuando las entradas S y R están a 1 se produce el estado
“prohibido” o indeterminación. En esta situación se puede predecir cómo van a quedar
las salidas, en este caso ambas en un solo nivel, lo que es desconocido es cómo
quedarán después de salir de ese estado.
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6. INFORME FINAL.
Presentar los resultados obtenidos en laboratorio, con los respectivos análisis de los datos
experimentales obtenidos, interpretando cada uno de los comportamientos físicos
obtenidos, para cada una de las prácticas elaboradas realizar las respectivas observaciones
con respecto a lo aprendido y emitir conclusiones de las mismas.
Tome en cuenta los objetivos de la práctica pues son muy importantes para la elaboración
final del informe.
Este informe será el vivo reflejo de lo que el alumno haya ejecutado como trabajo en
laboratorio.
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