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Compuertas Lógicas
Circuitos Digitales 1
Profesor:
Alumno:
2015
Laboratorio N°5: Compuertas Lógicas
UNMSM
COMPUERTAS LÓGICAS
I. INTRODUCCIÓN
II. OBJETIVOS
III. MATERIALES
Programa Dsch2
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IV. PROCEDIMIENTO
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Entonces en base al diseño del semisumador
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Empleando el símbolo en el circuito planteado en la pregunta A
obtenemos el siguiente esquema.
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B) Diseñar un sumador/restador en complemento a DOS, en base al
74LS283 (Full Adder de 4 bits) más puertas simples de ser
necesario.
- Resumen de hoja de datos Técnicos.
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- Simular el equivalente lógico del CI y definirlo como símbolo.
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- Mostrar el conexionado y simular el diseño.
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C) Diseñar un circuito que convierta un número binario natural (0-19) en
el correspondiente número en código BCD natural (2 dígitos:
unidades y decenas). Usar un bloque Full Adder de 4 bits como base
del diseño y puertas simples de ser necesario.
Nº Natural BA
0 00000 0000 0000
1 00001 0000 0001
2 00010 0000 0010
3 00011 0000 0011
4 00100 0000 0100
5 00101 0000 0101
6 00110 0000 0110
7 00111 0000 0111
8 01000 0000 1000
9 01001 0000 1001
10 01010 0001 0000
11 01011 0001 0001
12 01100 0001 0010
13 01101 0001 0011
14 01110 0001 0100
15 01111 0001 0101
16 10000 0001 0110
17 10001 0001 0111
18 10010 0001 1000
19 10011 0001 1001
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Entonces usando el sumador 74LS283 ya simulado en DSCH y
convertido a su respectivo símbolo el circuito para poder convertir
de natural a bcd queda de la siguiente forma:
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Luego introducimos el 10 en binario el cual va a ser mostrado en los
dos displays utilizados en el circuito. Lo cual podremos apreciar en la
siguiente simulación.
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D) Diseñar un COMPARADOR para dos números de 4 Bits en binario
natural A= A3 A2 A1 A0 y B = B3 B2 B1 B0. Usar UN solo bloque
sumador completo (FA) de 4 bits y puertas simples.
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E) Diseñar el ALU (Unidad Aritmética Lógica) según se especifica en la
figura.
- Un circuito Semirestador:
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- Un multiplexor de 8:2
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F) Para el circuito de la figura, hallar la expresión de la salida
F(A,B,C,D).
El decodificador 2:4:
Circuito Semi-restador:
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El multiplexor 4:1:
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Procederemos a analizar el circuito de salida:
- Para S0:
̅̅̅̅̅
𝑆0 = [(𝐴 ̅̅̅̅̅
̅. 𝐵̅). (𝐴. 𝐵̅) + (𝐴̅. 𝐵̅). (𝐴. ̅̅̅̅̅
𝐵̅)]⨁(𝐴 ̅. 𝐵̅). (𝐴. 𝐵̅)
𝑆0 = (𝐴̅. 𝐵̅)
- Para S1:
- Para S2:
𝑆2 = (𝐴̅. 𝐵)
- Para S3:
𝑆3 = (𝐴. 𝐵)
𝐹 = 𝐴̅𝐷(𝐵⨁𝐶) + 𝐴𝐵(𝐶
̅̅̅̅̅̅̅̅
+ 𝐷)
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