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INGENIERIA ELECTRICA
TRASMISOR
RECEPTOR
TRASMISOR OR
RECEPTOR
RECEPTOR
TRASMISOR
TRASMISOR Y RECEPTOR
TRASMISOR Y RECEPTOR
Baud Rate
La tasa de baudios tambin conocida como baudaje, Es el nmero de unidades de seal por segundo. Un baudio puede contener varios bits.
Bit de Paridad
Los cdigos de paridad se usan en comunicaciones para detectar,y en algunos casos corregir, errores en la transmisin. Para ellos se aade en origen un bit extra llamado bit de paridad a los n bits que forman el carcter original.
Este bit de paridad se determina de forma que el nmero total de bits 1 a transmitir sea par (cdigo de paridad par) o impar (cdigo de paridad impar).
Cdigo de paridad par El bit de paridad ser: Un 0 si el nmero total de 1 a transmitir es par, Un 1 si el nmero total de 1 es impar.
Cada pin puede ser de entrada o de salida, teniendo una funcin especifica cada uno de ellos. Las mas importantes son:
Pin Funcin Conector DB 25 Conector DB 9
DSR
RTS CTS DCD
Numero
de Pin
Seal
Descripcin
E/S
En DB-25 En DB-9 1 2 3 1 3 2 TxD RxD Masa chasis Transmit Data Receive Data S E
4
5 6 7 8 15 17 20
7
8 6 5 1 4
RTS
CTS DSR SG CD/DCD TxC(*) RxC(*) DTR
Request To Send
Clear To Send Data Set Ready Signal Ground (Data) Carrier Detect Transmit Clock Receive Clock Data Terminal Ready
S
E E E S E S
22
24
9
-
RI
Ring Indicator
E
S
Cada dispositivo tiene 2 USARTs, y puede ser configurado cada uno de forma independiente del otro.
Los pines del USART1 y USART2 son multiplexados con las funciones de: PORTC (RC6/TX1/CK1 y RC7/RX1/DT1) y PORTG (RG1/TX2/CK2 y RG2/RX2/DT2), respectivamente.
Para USART1:
El bit SPEN (RCSTA1<7>) debe estar seteado (=1)
Para USART2:
El bit SPEN (RCSTA2<7>) debe estar seteado (=1)
Se permite al dispositivo a transferir o recibir datos mientras esta en modo de reposo (Sleep)
TRANSMISOR USART
Diagrama de bloques de Trasmisor USART
RECEPTOR USART
Diagrama de bloques de Trasmisor USART
bit 7
CSRC: Bit de Seleccin de la Fuente del Reloj Modo Asncrono: Don`t care. Modo Sncrono: 1 = Modo Maestro (Reloj Generado Internamente desde BRG) 0 = Modo Esclavo (Reloj de Fuente Externa)
TX9: 9-bit bit de habilitacin de transmisin 1 = Selecciona una transmisin de 9 bits 0 = Selecciona una transmisin de 8 bits
bit 6
bit 5
TXEN: bit de habilitacin de transmisin 1 = Transmisin Habilitada 0 = Transmisin Deshabilitada NOTA: SREN/CREN anulan TXEN en modo Sncrono. SYNC: Bit de Seleccin de Modo USART 1 = Modo Sncrono 0 = Modo Asncrono No-Implementado: Es ledo como 0
bit 4
bit 3
bit 2
BRGH: Bit de Seleccin de Velocidad de Transmisin Modo Asncrono: 1 = Velocidad Alta 0 = Velocidad Baja Modo Sncrono: No utilizado en este modo.
TRMT: Bit de Estado de Registro de Desplazamiento de Transmisin
bit 1
1 = TRS vaco 0 = TRS lleno bit 0 TX9D: 9 bit de transmisin de datos Puede ser bit de direccin/dato o bit de paridad
bit 7
SPEN: Bit de Habilitacin de Puerto Serie 1 = Puerto serie habilitado (configura los pines RX/DT y TX/CK como pines de puerto serie) 0 = Puerto serie deshabilitado RX9: Bit de Habilitacin de Recepcin de 9-bit 1 = Selecciona la recepcin de 9-bits 0 = Selecciona la recepcin de 8-bits
bit 6
bit 5
SREN: bit de Habilitacin de Recepcin Simple Modo Asncrono: Dont Care Modo Sncrono-Maestro: 1 = Habilita la recepcin simple 0 = Deshabilita la recepcin simple Este bit se pone en cero cuando la recepcin se ha completado. Modo Sncrono-Esclavo: Dont Care.
bit 4
CREN: Bit de Habilitacin de Recepcin Continua Modo Asncrono: 1 = Habilita el receptor 0 = Deshabilita el receptor Modo Sncrono: 1 = Habilita la recepcin continua 0 = Deshabilita la recepcin continua ADDEN: bit de Habilitacin de Deteccin de Direccin. Modo Asncrono de 9 bits (RX9=1): 1 = deteccin de direccin habilitada, permite la interrupcin y la carga del buffer de recepcin cuando RSR<8> est en 1
bit 3
bit 2
FERR: bit de error de error de elaboracin 1 = Error de Elaboracin (se puede actualizar leyendo el registro RCREG y recibiendo el prximo bit vlido) 0 = sin error de elaboracin OERR: bit de error de rebase
1 = Error de rebase (puede ponerse en cero con el bit de limpieza CREN)
bit 1
bit 0